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metlino: add VHDCI EEM carrier connector

parent 83b209e3
...@@ -167,12 +167,168 @@ _io = [ ...@@ -167,12 +167,168 @@ _io = [
] ]
# via VHDCI carrier v1.1
_connectors = [
("eem0", {
"d0_cc_n": "E21",
"d0_cc_p": "E20",
"d1_n": "D26",
"d1_p": "E26",
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"d2_p": "D20",
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"d6_p": "B24",
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"d7_p": "E25",
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("eem1", {
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("eem2", {
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("eem3", {
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("eem4", {
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("eem5", {
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("eem6", {
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("eem7", {
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}),
]
class Platform(XilinxPlatform): class Platform(XilinxPlatform):
default_clk_name = "clk50" default_clk_name = "clk50"
default_clk_period = 20.0 default_clk_period = 20.0
def __init__(self): def __init__(self):
XilinxPlatform.__init__(self, "xcku040-ffva1156-1-c", _io, toolchain="vivado") XilinxPlatform.__init__(self, "xcku040-ffva1156-1-c", _io, _connectors, toolchain="vivado")
self.toolchain.bitstream_commands.extend([ self.toolchain.bitstream_commands.extend([
"set_property BITSTREAM.CONFIG.OVERTEMPSHUTDOWN Enable [current_design]", "set_property BITSTREAM.CONFIG.OVERTEMPSHUTDOWN Enable [current_design]",
"set_property BITSTREAM.GENERAL.COMPRESS True [current_design]", "set_property BITSTREAM.GENERAL.COMPRESS True [current_design]",
......
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